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時序錯誤

概要

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書目資訊

容忍時序錯誤的管線積體電路設計 = = Design of Pipelined VLSI Circuits for Tolerating Timing Errors / by: (書目-語言資料,印刷品)

容忍多重時序錯誤之管線化電路設計 = = Design of Pipelined Circuits for Tolerating Multiple Timing Errors / by: (書目-語言資料,印刷品)

容忍時序錯誤之彈性管線設計 = = Design of Elastic Pipelines for Tolerating Timing Errors / by: (書目-語言資料,印刷品)

可復原時序錯誤之管線的時序延遲填補 = = Delay Padding for Timing-Error-Resilient Pipelines / by: (書目-語言資料,印刷品)

主題

時序延遲填補

數位訊號處理

管線

錯誤復原設計

超大型積體電路設計

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