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RSA加解密演算法之時序容錯超大型積體電路設計 = = Design ...

吳宗翰

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博客來

RSA加解密演算法之時序容錯超大型積體電路設計 = = Design of Timing-Error-Tolerant VLSI Circuits for RSA Encryption and Decryption /

Record Type:	Language materials, printed : Monograph/item
Title/Author:	RSA加解密演算法之時序容錯超大型積體電路設計 = / 吳宗翰撰 ; 紀新洲指導
Reminder of title:	Design of Timing-Error-Tolerant VLSI Circuits for RSA Encryption and Decryption /
remainder title:	Design of Timing-Error-Tolerant VLSI Circuits for RSA Encryption and Decryption
Author:	吳宗翰
Published:	花蓮縣壽豐鄉 : 國立東華大學電機工程學系, : 2014[民103],
Description:	[17],76面 : 圖,表 ; 30公分
Notes:	校內電子全文開放日期 2014.8.13
Online resource:	http://134.208.29.93/cgi-bin/cdrfb3/gsweb.cgi?o=dstdcdr&i=ssid=%22610123113%22.

RSA加解密演算法之時序容錯超大型積體電路設計 = = Design of Timing-Error-Tolerant VLSI Circuits for RSA Encryption and Decryption /
吳宗翰

RSA加解密演算法之時序容錯超大型積體電路設計 = Design of Timing-Error-Tolerant VLSI Circuits for RSA Encryption and Decryption / Design of Timing-Error-Tolerant VLSI Circuits for RSA Encryption and Decryption吳宗翰撰 ; 紀新洲指導 - 初版 - 花蓮縣壽豐鄉 : 國立東華大學電機工程學系, 2014[民103] - [17],76面 : 圖,表 ; 30公分

校內電子全文開放日期 2014.8.13

碩士Master論文-- 國立東華大學電機工程學系

參考書目:75-76

贈書Subjects--Index Terms:

時序錯誤

RSA加解密演算法之時序容錯超大型積體電路設計 = = Design of Timing-Error-Tolerant VLSI Circuits for RSA Encryption and Decryption /
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246 1 1 $a Design of Timing-Error-Tolerant VLSI Circuits for RSA Encryption and Decryption
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500 $a 校內電子全文開放日期 2014.8.13
500 $a 校外電子全文開放日期 2014.8.13
500 $a 國圖全文開放日期 2014.8.13
500 $a 畢業學年度: 102
500 $a 指導教授: 紀新洲
502 $a 碩士Master論文-- 國立東華大學電機工程學系
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563 $a 贈書
653 0 $a 時序錯誤
653 0 $a RSA加解密演算法
653 0 $a 可重組系統
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653 0 $a timing errors
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